admin
发表于 2018-4-20 03:00:44
028为什么要设计有限状态机(1)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/028.avi
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发表于 2018-4-20 03:03:25
029为什么要设计有限状态机(2)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/029.avi
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发表于 2018-4-20 03:08:21
030verilog设计举例(1)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/030.avi
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发表于 2018-4-20 03:09:31
031verilog设计举例(2)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/031.avi
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发表于 2018-4-20 03:10:18
032verilog设计举例(3)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/032.avi
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发表于 2018-4-20 03:11:34
033verilog设计举例(4)(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/033.avi
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发表于 2018-4-20 03:16:14
034fpga设计中不同抽象级hdl的模型(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/034.avi
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发表于 2018-4-20 03:18:05
035时序逻辑设计要点(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/035.avi
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发表于 2018-4-20 03:19:54
036fpga设计中顶层测试verilog模块(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/036.avi
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发表于 2018-4-20 03:21:03
037fpga设计中不同抽象级hdl的模型(至芯科技FPGA培训视频教程)
http://www.fpgaw.com/data/attachment/fpga/xia/037.avi