时序分析数据输出延时和缓冲延时
数据输出延时（）：时钟触发开始到有效数据输出的器件内部所有延时的总和。简单地说，在时钟有效后，D的数据并不 能立即传到Q端，这段等待的时间就是触发器的时钟到输出时间。（这个时间指的是当时钟有效沿变化后，数据从输入端到输出端的最小时间间隔。）缓冲延时：信号经过缓冲器到达有效的电压输出所需要的时间。
= 逻辑延时 + 缓冲延时
如下图：给出确定的方法，在输出缓冲的末端直接相连一个测量负载，最常见的是50欧姆的电阻或30pF的电容，然后测量负载上的信号电压到达一定电平所需要的时间，这个电平称为测量电压（Vms），一般是信号高电平的一半。
发射沿和锁存沿
发射沿（launch edge）：源寄存器（前级寄存器）数据变化的时钟边沿，也是静态时序分析的起点；
锁存沿（latch edge）：目的寄存器（后级寄存器）数据锁存的时钟边沿，也是静态时序分析的终点。
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