Python0291
发表于 2021-9-11 10:50:25
基于FPGA的Verilog语法基础课程
Python0291
发表于 2021-9-11 10:56:36
Verilog HDL设计建模
dameihuaxia
发表于 2021-9-13 15:25:00
Verilog HDL设计建模
http://www.fpgaw.com/forum.php?mod=viewthread&tid=136378&fromuid=58166
(出处: fpga论坛|fpga设计论坛)
Python0291
发表于 2021-9-14 15:08:17
基于FPGA的Verilog语法基础课程
zhangyukun
发表于 2021-9-14 17:15:17
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发表于 2021-9-15 11:03:26
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发表于 2021-9-22 09:54:18
字符状态机的设计思想
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