zhiweiqiang33 发表于 2016-8-3 09:29:35

请教一个问题

请教一个问题：板子上的晶振是50M，然后调用pll输出时钟设定为80M。然后在tcl中约束in_clock 为50M， pll_out_clock 为80M 。这种约束还有必要吗？ 我如何才知道我这个约束有没有作用呢 ？

至芯兴洪 发表于 2016-8-3 21:17:40

没有必要啦，80Mhz的时钟怎么跑都没有问题，PLL应该也自动会产生80MHz的约束

zhiweiqiang33 发表于 2016-8-4 10:52:59

感谢老师的辛苦回答，拜谢；
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