zhiweiqiang33 发表于 2016-12-14 15:14:01

求大神解答，谢谢；

为什么用同步时序逻辑来设计数字逻辑电路，异步逻辑有什么不好？

zhiweiqiang33 发表于 2016-12-16 18:14:10

设计时序逻辑与组合逻辑的问题，请教；；

陈飞龙 发表于 2016-12-19 09:44:31

异步时序电路会发生亚稳态

zhiweiqiang33 发表于 2016-12-19 14:36:14

谢谢 回答 亚稳态会出现不稳定因素
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