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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › fifo半满的时候读
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fifo半满的时候读

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ddd 发表于 2012-8-18 08:50:59 | 显示全部楼层 |阅读模式
fifo半满的时候读
是不是最后有很多数没法读回来啊？
比如说最后没有数了
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