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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › SRAM读写时钟不同，用verilog做
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查看: 960|回复: 2

SRAM读写时钟不同，用verilog做

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920628 发表于 2013-6-27 14:22:23 | 显示全部楼层 |阅读模式
SRAM读写时钟不同，用verilog做
写用5M,读出来要48M
有没有高手指点一下
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 楼主| 920628 发表于 2013-6-30 17:06:43 | 显示全部楼层
至芯科技ZX系列开发板正在火爆发售！
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gusumurong 发表于 2013-7-1 18:24:48 | 显示全部楼层
这个应该很容易啊。
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