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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › 基于Verilog HDL的通信系统设计 第二天
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基于Verilog HDL的通信系统设计 第二天

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晓灰灰 发表于 2017-5-18 10:03:31 | 显示全部楼层 |阅读模式
第2章  常用Verilog语法














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fpga_feixiang 发表于 2017-5-18 11:45:29 | 显示全部楼层
PPT做的不错，很美
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zhiweiqiang33 发表于 2017-5-18 15:47:47 | 显示全部楼层
挺好的 课件 值得分享 谢谢楼主分享
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fpga_feixiang 发表于 2017-5-23 12:19:27 | 显示全部楼层
很经典，PPT牛逼
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d643189658 发表于 2017-8-17 18:49:52 | 显示全部楼层
谢谢楼主分享
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小舍YZ 发表于 2017-8-18 16:58:03 | 显示全部楼层
赞，，，，，，，，，，，，，，，谢谢分享。。。。。。。。。。。。。。。。。。。
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一个人的星空 发表于 2017-8-18 20:53:43 | 显示全部楼层
感谢楼主分享
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