1533742388 发表于 2014-1-14 11:22:48

谢谢楼主!!!!!!!!!!!!

hyz5122 发表于 2014-2-15 18:07:15

不错,感谢楼主!!!!!!!

hanhp 发表于 2014-4-9 14:37:16

学习学习学习学习

施楠 发表于 2014-4-15 14:31:01

frequence_divider_8frequence_divider_8

杨锦绣 发表于 2014-4-17 18:41:47

感觉都很断续啊   老师讲的很好啊

静禅 发表于 2014-4-28 19:57:32

......................

zhouming2010n 发表于 2014-5-11 02:10:12

好东西,看看

shengdishd 发表于 2014-5-16 11:31:05

1111111111111

944255195 发表于 2014-6-15 15:03:13

:) :) :) :)

fairybg 发表于 2014-6-25 19:48:58

ffffffffffffffffffffffffffffffffffffff
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查看完整版本: 010夏宇闻教授视频之FPGA设计中verilog模块中的信号(至芯科技FPGA培训视频教程)