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› FPGA倍频之后的时钟接DDR控制器的时钟输入,怎么DDR的数据就不粗来了呢
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发表于 2013-7-27 10:39:05
FPGA倍频之后的时钟接DDR控制器的时钟输入,怎么DDR的数据就不粗来了呢
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