fpga论坛|fpga设计论坛's Archiver
论坛
›
FPGA技术交流
› verilog 读文件为激励,仿真时却没有输入
ydq
发表于 2014-5-5 20:36:38
verilog 读文件为激励,仿真时却没有输入
我用$readmemh(“test.txt”)文件后进行仿真仿真波形输入没有输入。求教什么问题
页:
[1]
查看完整版本:
verilog 读文件为激励,仿真时却没有输入