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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › verilog 读文件为激励，仿真时却没有输入
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verilog 读文件为激励，仿真时却没有输入

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ydq 发表于 2014-5-5 20:36:38 | 显示全部楼层 |阅读模式
我用$readmemh（“test.txt”）文件后进行仿真  仿真波形输入没有输入。求教什么问题
至芯科技ZX系列开发板正在火爆发售！
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