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预览 谁用过TMS320C6678DSP芯片和XC6VSX315TFPGA芯片的？ 920628 2013-6-26 0822 920628 2013-6-26 12:51
预览 请问altera的fifo是不是上一时刻给读请求下一时刻读出来数据呢？ 920628 2013-6-26 0873 920628 2013-6-26 10:35
预览 请问：示波器中两路信号不相对移动，是否一定是频率相同？ 920628 2013-6-26 0808 920628 2013-6-26 10:14
预览 请问altera的fifo是不是上一时刻给读请求下一时刻读出来数据呢？ 北京幸福时代 2013-6-26 0786 北京幸福时代 2013-6-26 10:13
预览 怎么看编写的testbench脚本文件是否正确 920628 2013-6-26 0921 920628 2013-6-26 09:48
预览 有谁知道吗 1693269416 2013-6-26 0745 1693269416 2013-6-26 09:47
预览 帮忙看看 请教 zhiweiqiang33 2013-6-26 0861 zhiweiqiang33 2013-6-26 09:21
预览 问下有人用过K7的GTX么 IPO 2013-6-26 0771 IPO 2013-6-26 03:20
预览 请教个问题 920628 2013-6-25 0732 920628 2013-6-25 17:14
预览 请教个问题： 920628 2013-6-25 0774 920628 2013-6-25 17:13
预览 问一下，altera的异步fifo，是不是读了下一个周期就采样到正确的数据啦 920628 2013-6-25 0940 920628 2013-6-25 17:09
预览 这个时延是怎么控制的啊，是要我另外写逻辑？ 920628 2013-6-25 0851 920628 2013-6-25 17:01
预览 求救-74ls192怎么编写 verilog编写 新人帖 笨笨菲菲 2013-6-25 0842 笨笨菲菲 2013-6-25 16:43
预览 问问 大家？？ zhiweiqiang33 2013-6-23 2650 zhiweiqiang33 2013-6-25 16:27
预览 can_register #(8) ACCEPTANCE_CODE_REG0里面的#啥意思 1693269416 2013-6-25 0858 1693269416 2013-6-25 16:08
预览 请问各位那么ｒ的定义应该为多少位？ 920628 2013-6-25 0780 920628 2013-6-25 15:30
预览 tem1 <= (len_b downto 0 =>BitIn) and SR;这句vhdl语句是什么含义？ 新人帖 920628 2013-6-25 0776 920628 2013-6-25 15:28
预览 请教 zhiweiqiang33 2013-6-25 0864 zhiweiqiang33 2013-6-25 15:27
预览 请问一下大家verilog中数组占资源吗？跟BRAM相比有什么异同？ 1693269416 2013-6-25 0996 1693269416 2013-6-25 15:19
预览 EP4CE22的C3（PLL_CLKOUTp）,可以作为普通IO用吗？ 新人帖 1693269416 2013-6-25 0897 1693269416 2013-6-25 15:16
预览 大虾 请教 zhiweiqiang33 2013-6-25 0998 zhiweiqiang33 2013-6-25 14:59
预览 求推荐一款FPGA学习 新人帖 Kingsley 2013-6-25 2843 zhiweiqiang33 2013-6-25 11:48
预览 xilinx ip core的使用资料 attachment - [回帖奖励 2 ] zhiweiqiang33 2013-6-25 0807 zhiweiqiang33 2013-6-25 11:42
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