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FPGA技术交流 今日: 0|主题: 13294|排名: 8 

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预览 FPGA下载（AS模式）提示错误 Blank-Check failed on device 。这是什么问题啊 1693269416 2013-7-22 01246 1693269416 2013-7-22 16:07
预览 谁能给我共享一下quartusii 1693269416 2013-7-22 0858 1693269416 2013-7-22 16:05
预览 怎么写VGA时序啊？ 1693269416 2013-7-22 0924 1693269416 2013-7-22 15:35
预览 AD导出智能PDF 有的字符位置有偏移 有木有人遇到过？ 920628 2013-7-22 0872 920628 2013-7-22 12:37
预览 看了点资料感觉不错，分享给大家 920628 2013-7-22 0943 920628 2013-7-22 12:35
预览 请问有没有人做过FPGA的FM和AM调制？ 920628 2013-7-22 0896 920628 2013-7-22 11:47
预览 stm32怎么调试cc1101 920628 2013-7-22 0866 920628 2013-7-22 10:11
预览 stm32怎么调试cc1101 920628 2013-7-22 0779 920628 2013-7-22 10:08
预览 rtl视图应该是什么样？？ 920628 2013-7-22 0946 920628 2013-7-22 09:15
预览 弱弱的请教大家一个问题，若有一个20X20CM的六层PCB，网标无法导入，三天能做完吗？ 920628 2013-7-21 0820 920628 2013-7-21 17:43
预览 谁知道世界上最出名的PCB企业有哪几家 920628 2013-7-21 0749 920628 2013-7-21 17:26
预览 FPGA内部有没有可以例化的除法器？？ 920628 2013-7-21 0856 920628 2013-7-21 16:06
预览 请问再添加nios的时候编译会出错应该怎么做呢 920628 2013-7-21 1860 920628 2013-7-21 15:33
预览 出现了这样两条错误 请问哪位高手能指点下啊…… 920628 2013-7-21 0875 920628 2013-7-21 15:29
预览 为什么开发板没上电时候能检测到USB_b。一上电线就没了。。 920628 2013-7-21 0823 920628 2013-7-21 14:59
预览 是先分配引脚 后编译 在下载 还是先编译 后分配引脚 再下载 ？？ 920628 2013-7-21 0770 920628 2013-7-21 11:33
预览 可以编译通过 下载到板子上就运行不了 为啥？？ 920628 2013-7-21 0889 920628 2013-7-21 10:54
预览 计数分频 50M -> 67Hz， 示波器看只有47Hz，很不准怎么办？ 920628 2013-7-21 0779 920628 2013-7-21 10:49
预览 sounce_exp【5:0】 是什么意思 920628 2013-7-21 0826 920628 2013-7-21 10:23
预览 写你的AD是不停的工作吗？ 920628 2013-7-21 0779 920628 2013-7-21 10:21
预览 问下大家DSP Builder 都是用的哪个版本的啊 920628 2013-7-21 0858 920628 2013-7-21 10:18
预览 采集波形数据用FIFO存储，同时读写数据的时候怎样才能使存入FIFO的波形数据连续？ 920628 2013-7-21 0744 920628 2013-7-21 10:16
预览 怎么解决无线模块电压不一样的问题 920628 2013-7-21 0784 920628 2013-7-21 10:10
预览 遇到spi flash 焼写速度太慢的问题 ccs 2013-7-21 2920 ccs 2013-7-21 07:24
预览 xilinx ISE 14.4中怎么设置未使用IO的方式？ ccs 2013-7-21 2944 ccs 2013-7-21 07:17
预览 两个2-input LUT能否搭成一个3-input LUT？ ccs 2013-7-21 2879 ccs 2013-7-21 06:52
预览 我想用电脑发送0xfe到单片机P1口。程如下：#include<reg52.h> ccs 2013-7-21 0745 ccs 2013-7-21 06:41
预览 至芯科技FPGA工程师就业培训班即将开课 fpgaw 2013-4-20 41484 MOepKb 2013-7-20 18:41
预览 求大神指点什么原因 1693269416 2013-7-20 0890 1693269416 2013-7-20 17:21
预览 fpga 接收 以太网 数据包时，包头有个sop,包尾有个eop，这个常用吗？ 北京幸福时代 2013-6-1 31156 1693269416 2013-7-20 17:04
预览 请问一下verilog里面怎么把连个模块连接起来？ 1693269416 2013-7-3 2718 1693269416 2013-7-20 17:01
预览 有用过ＧＴＸ/ＧＴＰ的大侠请多多赐教啊 1693269416 2013-7-6 3831 zxopen08 2013-7-20 16:43
预览 综合后仿真结果不对从哪里查找原因啊？ 1693269416 2013-7-19 1735 zxopen08 2013-7-20 16:36
预览 请问在MATLAB下如何读一个由WRITE函数写入的字符数据文件？ 北京幸福时代 2013-7-20 1696 zxopen08 2013-7-20 16:32
预览 求助，为啥JTAG和AS下载结果不一样呢 北京幸福时代 2013-7-20 0684 北京幸福时代 2013-7-20 14:23
预览 谁有 EP4CE10F17 FPGA的原理图 参考下 920628 2013-7-20 0801 920628 2013-7-20 10:01
预览 求救：调制解调器使用matlab仿真的时候误码率一直居高不下。求救啊 920628 2013-7-20 0799 920628 2013-7-20 09:21
预览 LVDS传输，接收器端如果FPGA外部没有电阻匹配，那么可以在FPGA内部打开电阻匹配 IPO 2013-7-19 0805 IPO 2013-7-19 20:13
预览 DCM产生的频率怎么让内部信号使用。设置输出的类型是什么类型 IPO 2013-7-19 0773 IPO 2013-7-19 20:06
预览 verilog中怎样区分正负数啊 IPO 2013-7-19 0858 IPO 2013-7-19 19:56
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