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预览 mdio_data <= #1 {'pre,'st,mdio_opcode}; 这个语句什么意思？	北京幸福时代 2013-6-4	0794	北京幸福时代 2013-6-4 13:41
预览问题求救	zhiweiqiang33 2013-6-4	0881	zhiweiqiang33 2013-6-4 12:50
预览 CPLD运行着里面的寄存器就复位了，怎么回事？	zhiweiqiang33 2013-6-2	21266	DUfaww 2013-6-3 18:53
预览首次SPARTAN-6上调试ddr2，各种问题请教！！！	zhiweiqiang33 2013-6-2	11839	至芯兴洪 2013-6-2 10:41
预览 VERILOG怎么样实现顶层文件调用其他模块？	zhiweiqiang33 2013-6-2	12277	至芯兴洪 2013-6-2 10:26
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预览 [Spartan-6] 这样使用fifo算是跨时钟域吗？？	zhiweiqiang33 2013-6-2	21928	zhiweiqiang33 2013-6-2 10:22
预览什么是OpenCL？面向FPGA的OpenCL有何优点？	zhiweiqiang33 2013-6-2	0846	zhiweiqiang33 2013-6-2 10:21
预览利用赛灵思FPGA快速创建存储器接口的设计	zhiweiqiang33 2013-6-2	01773	zhiweiqiang33 2013-6-2 10:06
预览关于VHDL信号赋初值？？	zhiweiqiang33 2013-6-2	01198	zhiweiqiang33 2013-6-2 09:57
预览关于FPGA里面时序的问题	zhiweiqiang33 2013-6-2	0877	zhiweiqiang33 2013-6-2 09:53
预览 FPGA在无线通信领域的应用	zhiweiqiang33 2013-6-2	01316	zhiweiqiang33 2013-6-2 09:51
预览视频帧同步问题	zhiweiqiang33 2013-6-2	01494	zhiweiqiang33 2013-6-2 09:48
预览 Altera PLL仿真问题	zhiweiqiang33 2013-6-2	01696	zhiweiqiang33 2013-6-2 09:46
预览赛灵思28nm：点燃设计创新的激情	zhiweiqiang33 2013-6-2	01045	zhiweiqiang33 2013-6-2 09:44
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预览京微雅格：金山系列的FPGA芯片全解	zhiweiqiang33 2013-6-2	01250	zhiweiqiang33 2013-6-2 09:38
预览电平驱动问题	zhiweiqiang33 2013-6-2	01177	zhiweiqiang33 2013-6-2 09:37
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预览问个问题，熟悉CPLD的高手帮个忙拜谢	zhiweiqiang33 2013-6-2	01239	zhiweiqiang33 2013-6-2 09:24
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