集成电路技术分享

 找回密码
 我要注册

QQ登录

只需一步,快速开始

搜索
收藏本版 (8) |订阅

FPGA技术交流 今日: 0|主题: 13200|排名: 7 

作者 回复/查看 最后发表
预览 用EPF10K10LC84-4制作多功能电子钟 CHA 2010-6-28 12086 大鹏 2020-7-2 11:06
预览 基于Actel FPGA的UART应用 20080067 2010-5-3 23093 zxopenhl 2020-7-2 11:05
预览 VERILOG四位加法 fpga_feixiang 2020-7-1 31279 zhangyukun 2020-7-2 09:49
预览 Verilog中的信号 fpga_feixiang 2020-7-1 21328 大鹏 2020-7-1 17:23
预览 RISC CPU和它的外围电路 fpga_feixiang 2020-6-30 11122 fpga_feixiang 2020-6-30 15:15
预览 RISC CPU结构 fpga_feixiang 2020-6-30 11272 fpga_feixiang 2020-6-30 15:14
预览 FPGA开发板为什么要使用SDRAM attach_img 英尚微电子 2020-6-28 31520 大鹏 2020-6-30 14:46
预览 CPU设计原理 fpga_feixiang 2020-6-28 31475 大鹏 2020-6-30 14:45
预览 什么是CPU fpga_feixiang 2020-6-28 21294 zxopenhl 2020-6-30 14:44
预览 FPGA的应用场景 fpga_feixiang 2020-5-8 41467 大鹏 2020-6-28 14:09
预览 DDS结构图 fpga_feixiang 2020-6-22 21210 zxopenhl 2020-6-28 14:08
预览 双向管脚(clocked bidirectional pin)Verilog代码 老怪甲 2010-5-28 12923 大鹏 2020-6-27 14:55
预览 Modelsim后仿真心得 ccs 2010-6-20 22872 大鹏 2020-6-27 14:54
预览 fpga应用的三个主要方向 fpga_feixiang 2020-1-3 41655 大鹏 2020-6-26 17:35
预览 状态机综合的问题 interi 2010-6-26 64040 zxopenhl 2020-6-26 17:34
预览 vhdl介绍 fpga_feixiang 2020-6-25 2991 大鹏 2020-6-25 17:02
预览 VHDL与Verilog HDL的发展历程 fpga_feixiang 2020-6-25 21110 大鹏 2020-6-25 17:01
预览 vhdl和verilog的共同点 fpga_feixiang 2020-6-25 21054 zxopenhl 2020-6-25 17:00
预览 状态机的控制信号问题. CHAN 2010-6-26 12474 大鹏 2020-6-24 11:50
预览 Verilog中的注释 fpga_feixiang 2020-6-23 31370 zxopenhl 2020-6-24 11:48
预览 DDS原理分析 fpga_feixiang 2020-6-22 31419 大鹏 2020-6-23 16:59
预览 Verilog中的信号 fpga_feixiang 2020-6-23 21140 zhangyukun 2020-6-23 15:55
预览 DDS系统参数选择 fpga_feixiang 2020-6-22 11110 fpga_feixiang 2020-6-22 21:51
预览 DDS基本原理 fpga_feixiang 2020-6-22 11041 fpga_feixiang 2020-6-22 21:50
预览 认识DDS fpga_feixiang 2020-6-22 21271 大鹏 2020-6-22 17:40
预览 有没有人用过arria 10的片子 ccs 2020-6-22 21067 大鹏 2020-6-22 17:40
预览 DDS频率可调原理 fpga_feixiang 2020-6-22 31273 zxopenhl 2020-6-22 17:39
预览 有做FPGA软件刷新重注的没 ccs 2020-6-22 11016 ccs 2020-6-22 14:10
预览 FPGA 设计技巧分享 20080067 2010-4-29 12412 大鹏 2020-6-21 17:24
预览 关于vitex2-pro的fpga烧录 ddr 2010-4-12 12776 zxopenhl 2020-6-21 17:22
预览 FPGA在逻辑接口领域的应用 fpga_feixiang 2020-1-3 41852 大鹏 2020-6-20 16:43
预览 SDRAM与DDR有什么区别 fpga_feixiang 2020-6-3 21168 大鹏 2020-6-20 16:43
预览 USB数据包 fpga_feixiang 2020-6-16 21084 zxopenhl 2020-6-20 16:40
预览 问一下 microlbaze 用到定时器 定时器初值和定时时间是怎么计算的啊 ccs 2020-6-19 11120 ccs 2020-6-19 14:29
预览 usb包 fpga_feixiang 2020-6-12 21117 大鹏 2020-6-19 11:51
预览 U盘的USB2.0和3.0区别 fpga_feixiang 2020-6-11 21181 大鹏 2020-6-19 11:51
预览 USB硬件、概述 fpga_feixiang 2020-6-16 11064 zxopenhl 2020-6-19 11:49
预览 Vivado 软核MicroBlaze添加GPIO后在SDK里Debug admin 2020-6-19 11044 admin 2020-6-19 10:41
预览 大家调试gtp的时候有没有遇到过加上rxbuffer就track总掉,不加rxbuffer就不掉的情况? ccs 2020-6-19 1956 ccs 2020-6-19 10:40
预览 有人用vivado在线调试过DCM么 ccs 2020-6-19 11042 ccs 2020-6-19 10:40
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 我要注册

本版积分规则

关闭

站长推荐上一条 /1 下一条

QQ|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛 ( 京ICP备20003123号-1 )

GMT+8, 2025-5-3 10:35 , Processed in 0.061775 second(s), 17 queries .

Powered by Discuz! X3.4

© 2001-2023 Discuz! Team.

返回顶部 返回版块