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FPGA倍频之后的时钟接DDR控制器的时钟输入，怎么DDR的数据就不粗来了呢

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1693269416 发表于 2013-7-27 10:39:05 | 显示全部楼层 |阅读模式
FPGA倍频之后的时钟接DDR控制器的时钟输入，怎么DDR的数据就不粗来了呢
至芯科技ZX系列开发板正在火爆发售！
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