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VerilogHDL模块化程序设计

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lcytms 发表于 2018-5-4 08:57:23 | 显示全部楼层 |阅读模式
VerilogHDL模块化程序设计

中文期刊文章

作  者:向兵
作者机构:[1]绵阳职业技术学院,四川绵阳621000
出 版 物:《科技资讯》 (科技资讯)
年 卷 期:2017年 第27期

摘  要:
电子技术设计的核心是EDA,目前,EDA技术的设计语言主要有VerilogHDL和VHDL两种,相对来说VerilogHDL语言相对简单,上手快,其语法风格与C语言类似,据统计,VerilogHDL和VHDL的使用比率大概是80%和20%,在中国,大多数电子行业企业都采用Verilog。
而模块化的设计让VerilogHDL语言具有思路清晰、逻辑关系明确、可读性强等特点,模块化的设计在VerilogHDL语法设计中也成为主流。

页  码:12-13页
主 题 词:Verilog                EDA                模块化
学科分类:TP334.7
核心收录:暂无

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 楼主| lcytms 发表于 2018-5-4 08:59:10 | 显示全部楼层
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 楼主| lcytms 发表于 2018-5-4 09:00:26 | 显示全部楼层
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zhangyukun 发表于 2018-5-4 09:40:50 | 显示全部楼层
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晓灰灰 发表于 2018-5-4 11:18:27 | 显示全部楼层
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