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集成电路技术分享»论坛 › › FPGA技术交流 › 关于 verilog 的用法
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关于 verilog 的用法

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老怪甲 该用户已被删除
老怪甲 发表于 2010-4-24 15:53:13 | 显示全部楼层 |阅读模式
最近看verilog  时候发现有$display 这个调试输出. 可是这个输出是在哪里呢? 我用 ise  和modelsim的时候都没有找到 . .....
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老怪甲 该用户已被删除
 楼主| 老怪甲 发表于 2010-4-24 15:53:41 | 显示全部楼层
输出在modelsim的Transcript窗口
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小泡泡 发表于 2010-4-26 20:44:53 | 显示全部楼层
在哪里ishi可以找到的的
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weibode01 发表于 2010-11-9 11:03:06 | 显示全部楼层
不懂这个。。。
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