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FPGA中的stp文件

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ddr 发表于 2011-6-30 20:40:49 | 显示全部楼层 |阅读模式
FPGA中的stp文件  为什么显示waiting for clock啊,开始还好好的,后面再编译一次就这样了
 楼主| ddr 发表于 2011-6-30 20:41:11 | 显示全部楼层
可能是你的采样时钟没了。查查相关的时钟信号!
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