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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › 请问下，工程里面添加vio，例化了多个，可以吗？
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请问下，工程里面添加vio，例化了多个，可以吗？

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ccs 发表于 2019-10-23 21:36:23 | 显示全部楼层 |阅读模式
请问下，工程里面添加vio，例化了多个，可以吗？
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