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ISE综合后资源问题

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hebeiligeng 发表于 2012-3-6 22:05:39 | 显示全部楼层 |阅读模式
verilog程序经ISE 综合后LUT和reg使用过多，请问程序怎样优化可以降低这两方面资源？
至芯科技ZX系列开发板正在火爆发售！
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FPGA就业培训班招聘学员（保就业）
 楼主| hebeiligeng 发表于 2012-3-13 20:25:58 | 显示全部楼层
顶起！！！
至芯科技ZX系列开发板正在火爆发售！
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