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请问一个有关组件实例化的语法的问题,谢谢,

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zhtoad 发表于 2010-6-13 10:24:03 | 显示全部楼层 |阅读模式
各位,有一个语法不懂,请教各位。(我用的quartus 2 )
我在我的项目里面用到了iP核。他自动在项目目录(delayDDR)里面生成了子目录 testbench,里面有一个文件 ××_tb.vhd,应该是仿真用的。里面把IP(一个sdram控制器)例化了。
我不明白的是,这个××_tb.vhd里面,在architecture里面,有下面的语句。
dut : entity work.delayDDR  ---这个delayDDR是 项目名字
-- << END MEGAWIZARD INSERT DUT_INSTANCE_NAME
    port map
    (
        -- clocks and reset
        clock_source    =>  clk,          -- PLD input clock source from which all clocks are derived.
        reset_n         => reset_n,
-- << START MEGAWIZARD INSERT PORT_MAP
        clk_to_sdram  =>  clk_to_sdram,
        clk_to_sdram_n  =>  clk_to_sdram_n,
        -- ddr sdram interface
        ddr_cke       => cke,
        ddr_cs_n      => cs_n,
        ddr_ras_n     => ras_n,
        ddr_cas_n     => cas_n,
        ddr_we_n      => we_n,
        ddr_ba        => ba,
        ddr_a         => a,
        ddr_dq        => fpga_dq,
        ddr_dqs       => fpga_dqs,
        ddr_dm        => dm,
-- << END MEGAWIZARD INSERT PORT_MAP
        test_complete   => test_complete,
        pnf_per_byte    => pnf_per_byte,
        pnf             => pnf
    );

请问,这个语句是做什么用的,我的项目里面没有别的顶层文件,是空的,只有IP核自动生成的一些文件。 仿真文件××_tb.vhd是在项目文件的子目录里面。
不知道这个相当于组件实例化的语句有什么用?

谢谢。
CPLD 发表于 2010-6-20 22:00:01 | 显示全部楼层
为什么顶层是空的?
fpga0632 发表于 2010-6-23 05:02:07 | 显示全部楼层
我也曾利用IP核做过东西,有一些细节的问题要注意
Sunlife 发表于 2015-5-28 14:10:55 | 显示全部楼层

我也曾利用IP核做过东西,有一些细节的问题要注意
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