集成电路技术分享

 找回密码
 我要注册

QQ登录

只需一步,快速开始

搜索
查看: 1273|回复: 0

verilog 减法

[复制链接]
zhiweiqiang33 发表于 2012-9-25 10:47:29 | 显示全部楼层 |阅读模式
在写RTL代码时,如果用到减法,是直接用减,还是把减数取反加一再用加法?这两种写法综合之后会有什么区别?
您需要登录后才可以回帖 登录 | 我要注册

本版积分规则

关闭

站长推荐上一条 /1 下一条

QQ|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛 ( 京ICP备20003123号-1 )

GMT+8, 2025-6-26 12:11 , Processed in 0.063996 second(s), 19 queries .

Powered by Discuz! X3.4

© 2001-2023 Discuz! Team.

快速回复 返回顶部 返回列表