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楼主: HDL

有这样的负值语句吗?

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CHA 发表于 2010-6-26 13:17:41 | 显示全部楼层
哈哈,知道了,谢谢各位!!!
AAT 发表于 2010-6-26 13:39:18 | 显示全部楼层
我认为可以
ngtim 发表于 2010-6-26 14:04:42 | 显示全部楼层
呵呵<br>
高手如芸
FFT 发表于 2010-6-26 15:57:00 | 显示全部楼层
算什么问题呀
interi 发表于 2010-6-26 17:23:24 | 显示全部楼层
经常用的,显然可以
CHAN 发表于 2010-6-26 17:54:39 | 显示全部楼层
没问题
ANG 发表于 2010-6-26 18:35:37 | 显示全部楼层
q3={q1,q2}不行吗?<br>
<br>
呵呵,我是采鸟,真的不懂呀,为什么用&amp;就可以那,呵呵
interig 发表于 2010-6-26 19:46:13 | 显示全部楼层
呵呵,楼上用的是Verilog,楼主用的是VHDL,都可以哈``
interige 发表于 2010-6-26 20:25:11 | 显示全部楼层
OK!!!!!!!!!!!!!!!!!!!!!!!!!
Sunlife 发表于 2015-6-25 10:37:49 | 显示全部楼层
只要编译不报错,就应该没问题
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