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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › 用modelsim仿真时，initial占用仿真时间吗？
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用modelsim仿真时，initial占用仿真时间吗？

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tim 发表于 2010-6-27 22:58:03 | 显示全部楼层 |阅读模式
用modelsim仿真时，initial占用仿真时间吗？
initial, ModelSim, 仿真, 时间, 用modelsim仿真时

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FPGA工程师就业培训班（保就业）
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FPGA就业培训班招聘学员（保就业）
usb 发表于 2010-6-27 23:40:50 | 显示全部楼层
看看，大家讨论
至芯科技ZX系列开发板正在火爆发售！
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 楼主| tim 发表于 2010-6-28 00:39:28 | 显示全部楼层
我觉得应该不占用，除非是initial里面有延时，信号会被延时。
至芯科技ZX系列开发板正在火爆发售！
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Sunlife 发表于 2015-7-4 10:17:36 | 显示全部楼层
           我觉得不占
至芯科技ZX系列开发板正在火爆发售！
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