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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › VHDL转Verilog
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楼主: longtim

VHDL转Verilog

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VVC 发表于 2010-6-28 18:15:29 | 显示全部楼层
好动动，但是下不了啦，
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CHA 发表于 2010-6-28 20:15:22 | 显示全部楼层
转后不能综合
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UFO 发表于 2010-6-28 21:50:36 | 显示全部楼层
对VHDL一点都不了解，只是懂Verilog，转的东西能看懂吗
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inter 发表于 2010-6-28 22:30:43 | 显示全部楼层
谢谢楼住了!
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ngtim 发表于 2010-6-28 23:05:34 | 显示全部楼层
这个还是自己转的比较好吧
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inter 发表于 2010-6-28 23:55:23 | 显示全部楼层
第一次接触<br>
有点点滴滴做起<br>
1谢谢
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少将师长 发表于 2010-7-10 21:21:56 | 显示全部楼层
没见啊……
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wang182004 发表于 2010-7-15 08:43:34 | 显示全部楼层
我看都看不到啊。。
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jhy222222 发表于 2010-8-1 20:47:42 | 显示全部楼层
看不到。。没钱。。
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ktboy0502 发表于 2010-8-2 20:11:21 | 显示全部楼层
值得一试啊
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