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集成电路技术分享»论坛 › › FPGA资料下载 › PLL分频Verilog HDL语言编写
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PLL分频Verilog HDL语言编写

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老怪甲 该用户已被删除
老怪甲 发表于 2010-9-20 09:40:39 | 显示全部楼层 |阅读模式
Verilog HDL语言编写EP2C8Q208芯片PLL分频的简单程序，50MHz分频为12MHz

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pgfzhy 发表于 2010-11-9 19:02:45 | 显示全部楼层
谢谢，分享，真的很好的东西。
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CrazyDiode 发表于 2011-9-15 14:26:50 | 显示全部楼层
好东西 看看
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巴黎双人舞 发表于 2011-10-5 11:15:37 | 显示全部楼层
谢谢分享。
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wqq870228 发表于 2011-10-8 18:55:39 | 显示全部楼层
谢谢楼主的无私分享
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fpga_feixiang 发表于 2022-1-27 18:56:01 | 显示全部楼层
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