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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › 问个简单的问题，在verilog中可以用绝对值吗？
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查看: 919|回复: 1

问个简单的问题，在verilog中可以用绝对值吗？

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IPO 发表于 2014-3-25 08:57:34 | 显示全部楼层 |阅读模式
问个简单的问题，在verilog中可以用绝对值吗？
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FPGA就业培训班招聘学员（保就业）
fpgaw 发表于 2014-3-25 10:16:00 | 显示全部楼层
不可以,得用语言自己写，判一下符号位就行
FPGA工程师就业培训班（保就业）
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