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fpga论坛|fpga设计论坛»论坛 › › FPGA技术交流 › modelsim仿真,输出信号为什么是X?
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modelsim仿真,输出信号为什么是X?

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创客 发表于 2014-5-2 12:44:39 | 显示全部楼层 |阅读模式
本帖最后由 创客 于 2014-5-2 12:44 编辑

希望各位可以解答

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FPGA就业培训班招聘学员（保就业）
王建飞 发表于 2014-5-2 22:06:42 | 显示全部楼层
出现这种问题，一般是因为在工程代码中，变量没有赋初值！
FPGA工程师就业培训班（保就业）
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 楼主| 创客 发表于 2014-5-3 15:56:27 | 显示全部楼层
嗯,是的,thank you,飞哥的板子做的不错噢,呵呵
至芯科技ZX系列开发板正在火爆发售！
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