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预览 有了解S3c2440的?请教一哈 -40和-30在程序移植 上有没有差异吧? IPO 2011-4-8 01806 IPO 2011-4-8 15:01
预览 DDS的一些问题 attach_img lupengpeng 2011-4-8 12013 lupengpeng 2011-4-8 14:13
预览 求方法 aouo1987 2011-4-7 11353 哦十全_至芯学员 2011-4-8 10:53
预览 求教一个同步的问题? attach_img ssss 2011-4-8 01225 ssss 2011-4-8 10:39
预览 有没有前辈听说过FPGA在金融数据分析上面的应用的? vvt 2011-4-8 01341 vvt 2011-4-8 09:34
预览 请教一个时钟问题(多时钟?) vvt 2011-4-8 31507 vvt 2011-4-8 05:48
预览 如何禁用Quartus原理图的自动连接功能? vvt 2011-4-8 21826 vvt 2011-4-8 05:47
预览 VHDL语言完成CPLD设计制作二路复用的2.048MHz时钟信号和二路8KHz帧同步信号。 x15935789 2011-4-6 21408 x15935789 2011-4-7 18:42
预览 我用ise9.2时,突然不能综合了,即双击synthesize时等待一会,之后没有任何显示, guanguan 2011-4-7 01741 guanguan 2011-4-7 17:51
预览 用verilog写了一个程序控制l298n驱动(带光耦)再接上电机 guanguan 2011-4-7 01748 guanguan 2011-4-7 17:50
预览 嵌入式逻辑分析仪中 run analysis 后一直显示 waiting for clock 怎么解决 icastle 2011-4-7 01404 icastle 2011-4-7 15:35
预览 求思路 polozpt 2011-4-1 31632 polozpt 2011-4-7 13:22
预览 怎样在FPGA里调用DSP TCL 2010-10-28 12110 hng1123 2011-4-7 12:40
预览 DSP的版本要不要和MATLAB以及Quartus一致啊? IPO 2010-6-5 12260 hng1123 2011-4-7 12:39
预览 fifo的时钟 hng1123 2011-4-7 01483 hng1123 2011-4-7 12:34
预览 那位大侠有异步双时钟FIFO的VHDL代码? ddr 2010-4-26 64653 hng1123 2011-4-7 12:32
预览 关于FIFO的VHDL HANG 2010-6-27 12195 hng1123 2011-4-7 12:28
预览 求一基于FPGA的液位检测系统的设计  ...2 小松 2010-5-4 1013931 hng1123 2011-4-7 12:27
预览 请问有谁构建过niosii双核系统的吗? vvt 2010-8-6 12584 hng1123 2011-4-7 12:18
预览 FPGA进行开发嵌入式系统中用的几个发展方向 老怪甲 2010-12-3 32672 hng1123 2011-4-7 12:15
预览 我们在cyclone常编程序的时候,定义的寄存器是谁给提供的啊?是M4K提供的吗 IPO 2010-5-12 22435 hng1123 2011-4-7 11:55
预览 cyclone中的M4k掉电后内容会消失么? wang 2010-5-23 22682 hng1123 2011-4-7 11:50
预览 altera的cyclone III系列EP3C10,这款片子分8个Bank,那什么是Bank呀?什么意思啊? ccs 2010-6-25 23085 hng1123 2011-4-7 11:48
预览 步进电机控制器 hng1123 2011-4-7 01733 hng1123 2011-4-7 11:45
预览 使用FPGA(Cyclone max.Frequency.up.to.275MHz)如何产生0.5ns左右的超短脉冲 interig 2010-6-27 22219 hng1123 2011-4-7 11:43
预览 有关于cyclone和cyclone2的区别的文档 ccs 2010-9-20 53656 hng1123 2011-4-7 11:28
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预览 关于Avolon总线 hng1123 2011-4-7 11306 hng1123 2011-4-7 09:49
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预览 请教一个问题,老鸟们请指教。 老怪甲 2010-7-1 31779 wangli_peking 2011-4-6 22:12
预览 求助:在ALTERA FPGA设计中遇到这样的问题。 weibode01 2010-11-9 21887 wangli_peking 2011-4-6 22:01
预览 为什么以太网收发包经过dma通道sdram数据丢失 老怪甲 2010-7-1 32452 wangli_peking 2011-4-6 21:59
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预览 用ISE来写程序,并且用ISE来调用modelsim就可以仿真,直接打modelsim就不好使 vvt 2011-4-6 32506 wangli_peking 2011-4-6 21:44
预览 问下vhdl语言中的generate生成语句一定要有标号么 IPO 2011-4-6 22135 wangli_peking 2011-4-6 21:42
预览 关于自制元件调用的问题?? hng1123 2011-4-6 11870 hng1123 2011-4-6 20:48
预览 生成语句(generate)的作用 hng1123 2011-4-6 53950 hng1123 2011-4-6 20:43
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预览 modelsim到simulate(loading)的时候界面就关闭了是怎么回事 IPO 2011-4-6 01592 IPO 2011-4-6 17:59
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