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预览 port 端口说明中的输入输出全是信号量,不能是实数型变量? CHANG 2010-6-26 02198 CHANG 2010-6-26 00:57
预览 数码管的引脚锁定问题 ups 2010-6-26 02042 ups 2010-6-26 00:56
预览 .sof程序下载进去的时候,FPGA过不多久就自动复位 interi 2010-6-26 01970 interi 2010-6-26 00:55
预览 关于FSK在波形仿真的时候这两个信号的周期相差太大 HDL 2010-6-26 02248 HDL 2010-6-26 00:50
预览 海量数据存储,用CPLD或fpga实现PCI接口?! longtime 2010-6-26 02105 longtime 2010-6-26 00:48
预览 液晶屏的接口cpld与sed1335接口 inter 2010-6-26 02490 inter 2010-6-26 00:46
预览 求助:毕业设计基于CPLD的HDB3编码 tim 2010-6-26 02543 tim 2010-6-26 00:42
预览 编写高效的测试设计(testbenches longtim 2010-6-26 02359 longtim 2010-6-26 00:42
预览 如何用CPLD或fpga做总线驱动? CHANG 2010-6-26 02239 CHANG 2010-6-26 00:41
预览 在FPGA上验证能跑起来,相同代码,CPLD上跑不起来 VVIC 2010-6-26 02733 VVIC 2010-6-26 00:38
预览 什么是组合反馈,应该如何避免 encounter 2010-6-26 02340 encounter 2010-6-26 00:38
预览 关于cpld发脉冲的问题,两段代码一个有输出,一个没有,不知道为什么。 tim 2010-6-26 02511 tim 2010-6-26 00:38
预览 Almost one-hot encoding是什么意思? 粉妮 2010-6-25 22808 麦子 2010-6-26 00:38
预览 如何用电路实现整数取反,如输入5,经过电路后输出-5 encounter 2010-6-26 02311 encounter 2010-6-26 00:34
预览 有关CRC的结果有没有可能是全0 蓦然囙首 2010-6-25 12761 神仙姐姐 2010-6-26 00:33
预览 请问:CPLD厂家提供的低层的标准库是否都已不存在竞争冒险问题? usd 2010-6-26 02149 usd 2010-6-26 00:32
预览 Lattice的isplever的问题 别生气咯 2010-6-26 02330 别生气咯 2010-6-26 00:30
预览 请教版主 蓦然囙首 2010-6-25 12407 蓝雪 2010-6-26 00:29
预览 fpga HANG 2010-6-26 02176 HANG 2010-6-26 00:26
预览 QUARTUS里面怎么没有象XILINX里设计状态机那样的工具? tim 2010-6-26 02743 tim 2010-6-26 00:25
预览 状态机综合的问题 inter 2010-6-26 02397 inter 2010-6-26 00:22
预览 如何在板子上调试符合要求的状态机? AAT 2010-6-26 02369 AAT 2010-6-26 00:19
预览 状态机,但是仿真显示状态不变化 ANG 2010-6-26 02366 ANG 2010-6-26 00:19
预览 本人正在设计的一个芯片,综合后的电路图杂乱文章,信号线错综复杂 海龟 2010-6-25 02204 海龟 2010-6-25 23:57
预览 请教关于用first encounter做layout 蓝色海域 2010-6-25 02267 蓝色海域 2010-6-25 23:54
预览 语音芯片是TLV320AIC23B数字音频控制接口设计的状态机设计 夜带水果刀 2010-6-25 02651 夜带水果刀 2010-6-25 23:22
预览 如何求解一个电路的最大瞬态电流,哪些工具可以帮助我们实现这一想法呢? 神仙姐姐 2010-6-25 02160 神仙姐姐 2010-6-25 23:12
预览 关于sof和pof文件的问题! zhaoyiman 2010-6-25 02533 zhaoyiman 2010-6-25 11:16
预览 谁能帮写一个BP网络算法的Verilog或者VHDL程序,价钱商量 muwu324 2010-6-25 02305 muwu324 2010-6-25 10:36
预览 关于ALTERA FPGA 烧写程序不运行的问题 attach_img hugoodboy 2010-6-25 03227 hugoodboy 2010-6-25 10:20
预览 Quartus中仿真时出现no simulation input file assignment specify 解决方法 vhdl 2010-6-24 02546 vhdl 2010-6-24 08:46
预览 sram的verilog程序 CPLD 2010-6-23 04166 CPLD 2010-6-23 14:25
预览 FPGA中有定时器模块吗?如果有怎么调出来啊 supercgai 2010-6-4 32619 fpga0632 2010-6-23 04:50
预览 求助 pex857617729 2010-6-9 12165 amyxxf 2010-6-22 23:06
预览 谁能帮忙弄一个vhdl计时程序 要求分和秒 含顶层文件 dds 2010-6-22 02301 dds 2010-6-22 18:02
预览 fpga仿真软件哪个好用? vvt 2010-6-19 57218 shuhai32 2010-6-22 16:17
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