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预览 f.i.r.滤波器设计 attachment 晓灰灰 2019-3-19 41671 大鹏 2022-3-11 16:49
预览 Verilog代码编写规范 longtim 2010-6-27 93559 大鹏 2022-3-2 13:44
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预览 静态、动态时序模拟的优缺点 fpga_feixiang 2019-6-6 42152 zxopenhl 2022-3-2 13:42
预览 pcb涂布工艺流程 风沙飞雪 2019-6-11 21929 大鹏 2022-2-27 09:16
预览 FPGA三大趋势充满机会 fpga_feixiang 2020-8-17 31840 大鹏 2022-2-26 12:00
预览 请问各位FPGA大神,有谁遇到过flash固化的程序能正常起来,但是单独的读写擦flash... ccs 2022-2-24 1951 zxopenhl 2022-2-26 11:59
预览 有没有FPGA高手做过sdc约束,或者有sdc的模板吗 ccs 2022-2-24 0896 ccs 2022-2-24 11:21
预览 fpga里两个模块之间定义一个80位宽的端口连接和用五个16位宽的端口连接有时序好坏... ccs 2022-2-22 2910 大鹏 2022-2-24 09:38
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预览 给一个80位宽的reg赋值也和给5个16位的reg赋值一样吗 ccs 2022-2-22 2899 zxopenhl 2022-2-24 09:36
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预览 VREF管脚的连接问题 沉醉夕阳下 2010-6-25 43302 大鹏 2022-2-14 14:49
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