如何实现两个不同信号的沿的触发

longtim · 发表于 2010-6-26 01:31:56

本帖最后由 fpgaw 于 2010-7-6 06:31 编辑

意思是实现一个功能如下当busy（异步）的下降沿到来的时候，输出两个周期的脉冲，这个输出脉冲的周期是输入脉冲的两倍，个人感觉比较麻烦，没有思路，麻烦给点儿提示

FFT · 发表于 2010-6-26 02:36:38

这是不同clock间同步的问题， 
不需要用“两个不同信号的沿的触发”

ICE · 发表于 2010-6-26 04:19:00

用几个寄存器延迟一下看行不行

CHA · 发表于 2010-6-26 05:09:25

1,状态机自然是最方便的方法解决这个问题,可设如下状态机:用BUSY信号判断,当Busy分别为:1-->1;1-->0;0-->0(此处为下降沿后的第一个时钟周期),0-->0;0-->1时,得出所需周期信号clkout分别为:0,1,1,0,0, 
2,可以用设标志位来实现,如在下降沿到来后令flag==1,延迟两个周期后flag==0,当flag==1的时候,输出时钟clkout为:1,其余为零,配合计数器实现,应该很简单 
 
[ 本帖最后由 tingwhere 于 2007-1-31 17:22 编辑 ]

CHANG · 发表于 2010-6-26 07:03:30

必须使用高速时钟采样busy,检查到busy下降边沿后输出一高电平,再将此输出寄存器延长一周期即可 
简便实用

Sunlife · 发表于 2015-6-17 11:32:03

,状态机自然是最方便的方法解决这个问题,可设如下状态机:用BUSY信号判断,当Busy分别为:1-->1;1-->0;0-->0(此处为下降沿后的第一个时钟周期),0-->0;0-->1时,得出所需周期信号clkout分别为:0,1,1,0,0, 
2,可以用设标志位来实现,如在下降沿到来后令flag==1,延迟两个周期后flag==0,当flag==1的时候,输出时钟clkout为:1,其余为零,配合计数器实现,应该很简单

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