集成电路技术分享

 找回密码
 我要注册

QQ登录

只需一步,快速开始

搜索
收藏本版 (8) |订阅

FPGA技术交流 今日: 0|主题: 13318|排名: 8 

作者 回复/查看 最后发表
预览 Custom Script for Reporting attach_img 王建飞 2015-9-2 01027 王建飞 2015-9-2 09:36
预览 Simplify Design Reuse with Dynamic SDC Constraints attach_img 王建飞 2015-9-2 01032 王建飞 2015-9-2 09:33
预览 Get Clocks Feeding a Pin 王建飞 2015-9-2 0799 王建飞 2015-9-2 09:29
预览 TimeQuest Example—Clock Enable Multicycle attach_img 王建飞 2015-9-2 0885 王建飞 2015-9-2 09:28
预览 Z2开发板 找不到 复位引脚 新人帖 莫非是墨菲 2015-9-1 01076 莫非是墨菲 2015-9-1 16:51
预览 Constraining an Edge-Aligned Source-Synchronous Output attach_img 王建飞 2015-9-1 01048 王建飞 2015-9-1 16:36
预览 Constraining a Center-Aligned Source-Synchronous Output attach_img 王建飞 2015-9-1 0856 王建飞 2015-9-1 16:28
预览 TimeQuest Clock Multiplexer Examples attach_img 王建飞 2015-9-1 01513 王建飞 2015-9-1 16:15
预览 TimeQuest Example: Constraining Generated Clocks attach_img 王建飞 2015-9-1 0983 王建飞 2015-9-1 15:45
预览 有没有关于Quartus II中Qsys IP核解释的文档?小梅哥 attachment CPLD 2015-8-1 31582 王建飞 2015-9-1 15:06
预览 TimeQuest Example: Multicycle Exceptions attach_img 王建飞 2015-9-1 0925 王建飞 2015-9-1 14:55
预览 TimeQuest Example: Basic SDC Example 王建飞 2015-9-1 0944 王建飞 2015-9-1 14:49
预览 关于DE2-115开发板问题 新人帖 wenquan 2015-8-27 11239 admin 2015-9-1 13:20
预览 各位大神,我想请问一下,我这有个FPGA的电路原理图,我怎么看它是串行配置还是并... IPO 2015-8-31 01134 IPO 2015-8-31 15:19
预览 在verilog语言中,if(a==(b+1)) 这个语句有木有问题啊 关系运算符右边可不可以使用... ccs 2015-8-28 0985 ccs 2015-8-28 08:42
预览 谁用过FPGA的ISERDES模块啊 vvt 2011-6-19 12265 rtnjust 2015-8-27 15:59
预览 ISERDES的使能信号CE1CE2能否作为输入输出的时序控制 attach_img 天空少侠 2014-4-7 33116 rtnjust 2015-8-27 15:59
预览 Debussy 代码调试工具 教程资料 attachment zhiweiqiang33 2013-5-28 52958 zhiweiqiang33 2015-8-27 09:24
预览 讨论FPGA? zhiweiqiang33 2015-8-26 11252 清霜一梦 2015-8-26 21:12
预览 请教一个C语言的问题 zhiweiqiang33 2015-8-25 11412 zhiweiqiang33 2015-8-25 11:44
预览 基于FPGA的DDS信号发生器 新人帖 无敌小明思密达 2015-4-9 31896 777 2015-8-17 20:16
预览 上海一外企的fpga笔试题(今天我刚考完的)  ...23 ups 2010-6-27 2813760 自恋狂 2015-8-16 10:30
预览 多时域设计中,如何处理信号跨时域。(南山之桥笔试题) fpga 2010-4-8 96540 自恋狂 2015-8-16 10:04
预览 凹凸科技笔试题  ...2 fpga 2010-4-8 1010742 自恋狂 2015-8-16 09:59
预览 (汉王笔试题)你知道那些常用逻辑电平?TTL与COMS电平可以直接互连吗?  ...2 fpga 2010-4-8 1713342 自恋狂 2015-8-16 09:56
预览 虹微 笔试题 fpga 2010-4-8 65984 自恋狂 2015-8-16 00:34
预览 xilinx ise fpga cpld设计指南 387页 85.3M 清晰书签版 attach_img wudi123baobei 2014-11-12 73369 lf863186523 2015-8-15 10:37
预览 电脑中能否装两个quartus? vvt 2015-8-13 31234 小泰 2015-8-14 15:38
预览 周立功FPGA笔试题  ...23 fpga 2010-4-8 2320543 低空翾翔 2015-8-14 10:18
预览 FPGA xilinx xc6slx100 内部iserdes资源 能不能支持 16路 1G速度的差分数据 vvt 2015-8-13 01199 vvt 2015-8-13 20:19
预览 请问有谁知道怎么用电路实现2a+b吗? vvt 2015-8-13 0999 vvt 2015-8-13 20:18
预览 altera de4用不了opencl怎么办? vvt 2015-8-13 01115 vvt 2015-8-13 20:18
预览 有没有谁使用过含tlk2501模块的 FPGA板子 vvt 2015-8-12 01047 vvt 2015-8-12 14:26
预览 debussy调试工具资料 attachment zhiweiqiang33 2013-2-21 62289 清霜一梦 2015-8-12 13:28
预览 Modelsim调用task出错——请教 清霜一梦 2015-8-8 41758 王建飞 2015-8-12 01:06
预览 设计一个简单的CPU——RISC_SPM attachment 陈飞龙 2015-8-10 43899 陈飞龙 2015-8-11 22:59
预览 win8下面xilinx板子的jtag驱动安装老是显示数据签名无效是怎么回事? ccs 2015-8-11 0999 ccs 2015-8-11 19:38
预览 74.25Mhz分频12.288Mhz和11.2896MHz,怎么弄吗用的是spartan6 IPO 2015-8-11 0903 IPO 2015-8-11 05:45
预览 如果fpga io口电压为2.5-3v,不到3.3v,是否可能导致收不到数据 IPO 2015-8-11 0983 IPO 2015-8-11 05:43
预览 FPGA计算器总结 新人帖 attachment 第一个臭皮将 2015-8-9 41407 第三个臭皮酱 2015-8-10 19:22
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 我要注册

本版积分规则

关闭

站长推荐上一条 /1 下一条

QQ|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛 ( 京ICP备20003123号-1 )

GMT+8, 2025-10-8 09:44 , Processed in 0.059118 second(s), 16 queries .

Powered by Discuz! X3.4

© 2001-2023 Discuz! Team.

返回顶部 返回版块