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预览 CPU中的RISC和CISC	fpga_feixiang 2020-5-16	31218	zxopenhl 2020-5-16 16:54
预览 Xilinx COE文件格式	fpga_feixiang 2020-5-16	11452	fpga_feixiang 2020-5-16 01:07
预览 TLC549驱动时序与采样过程	fpga_feixiang 2020-3-2	21257	大鹏 2020-5-15 09:36
预览 TLC549驱动的硬件编写	fpga_feixiang 2020-3-2	21250	大鹏 2020-5-15 09:35
预览 CISC简介	fpga_feixiang 2020-5-13	21159	zxopenhl 2020-5-15 09:33
预览 RISC简介	fpga_feixiang 2020-5-13	21248	大鹏 2020-5-14 17:18
预览 CPU的RISC和CISC架构的区别	fpga_feixiang 2020-5-12	21286	大鹏 2020-5-14 17:17
预览 RISC和CISC处理器的主要区别	fpga_feixiang 2020-5-12	21229	zxopenhl 2020-5-14 17:16
预览 AD转换原理	fpga_feixiang 2019-11-6	31536	大鹏 2020-5-12 15:36
预览逻辑分析仪和示波器的区别	fpga_feixiang 2020-5-3	31259	大鹏 2020-5-12 15:36
预览有人配置过adv7513吗	ccs 2020-5-11	21134	zxopenhl 2020-5-12 15:35
预览有人遇到过vivado关联vs之后第二次打卡vivado就自动取消和vs的关联了又得重新设置	ccs 2020-5-11	11097	ccs 2020-5-11 13:01
预览 FPGA 的浮点乘法运算能力	fpga_feixiang 2020-5-8	31468	zxopenhl 2020-5-9 18:29
预览逻辑分析仪测量数字电路比示波器的优势	fpga_feixiang 2020-5-4	11153	大鹏 2020-5-8 11:47
预览逻辑分析仪和示波器	fpga_feixiang 2020-5-3	11244	大鹏 2020-5-7 10:15
预览数据埋点的原理	fpga_feixiang 2020-5-6	21256	zxopenhl 2020-5-7 10:13
预览 FPGA高速采集	fpga_feixiang 2020-5-6	21262	zhangyukun 2020-5-7 09:40
预览 AD转换原理	fpga_feixiang 2020-5-6	11122	大鹏 2020-5-6 18:19
预览一个信号经过下变频后，采样率是200m，带宽是300m，两路输出（两个data_i，两个dat...	ccs 2020-5-5	21234	ccs 2020-5-5 08:03
预览知道“1、1、-1、-1……”这样一组数，怎样弄出bpsk波形?能用ISE的dds吗	ccs 2020-5-5	21143	ccs 2020-5-5 08:02
预览 DDR2与DDR的区别	fpga_feixiang 2019-11-13	11414	大鹏 2020-5-2 08:33
预览线与逻辑	fpga_feixiang 2020-4-21	111354	zxopenhl 2020-5-2 08:32
预览 VHDL数据类型	fpga_feixiang 2019-10-21	41566	zhangyukun 2020-5-1 09:50
预览 U盘的USB2.0和3.0区别	fpga_feixiang 2020-4-30	21234	zhangyukun 2020-5-1 09:50
预览 SPI简介	fpga_feixiang 2020-4-23	41341	大鹏 2020-5-1 08:38
预览 Quartus ii 从哪看状态机有没有设置安全模式	ccs 2020-4-24	21594	大鹏 2020-5-1 08:38
预览 usb包结构	fpga_feixiang 2020-4-28	11222	大鹏 2020-4-29 13:47
预览 SPI特征	fpga_feixiang 2020-4-26	11181	大鹏 2020-4-27 14:07
预览 SPI操作模式	fpga_feixiang 2020-4-26	11368	zxopenhl 2020-4-27 14:06
预览固化FPGA配置芯片	Python0291 2020-4-26	21449	zxopenhl 2020-4-26 18:02
预览 SPI特点	fpga_feixiang 2020-4-23	11389	大鹏 2020-4-25 15:12
预览系统最高速度计算（最快时钟频率）和流水线设计思想	fpga_feixiang 2020-4-18	21493	zxopenljx 2020-4-25 13:17
预览 FIFO的一些重要参数	fpga_feixiang 2020-4-19	21431	zxopenljx 2020-4-25 13:16
预览 DDR和DDR2，DDR3，区别在那里	fpga_feixiang 2020-4-14	21677	zxopenljx 2020-4-25 13:15
预览什么是亚稳态？为什么两级触发器可以防止亚稳态传播	fpga_feixiang 2020-4-18	31651	zxopenljx 2020-4-25 13:15
预览用modelsim在仿真MIG IP核的时候为什么Init_calib_complete一直不拉高吗？求教	ccs 2020-4-24	22953	zxopenljx 2020-4-25 13:14
预览 quartus环境下，一个缺口时钟，经PLL输出成一个稳定的50%占空比时钟，咱们的IP	ccs 2020-4-24	111236	ccs 2020-4-24 18:20
预览有没有人知道在vivado怎样调用别人已经做好的IP核	ccs 2020-4-24	11324	ccs 2020-4-24 18:18
预览 FPGA 和 CPLD 的区别	fpga_feixiang 2020-4-22	11334	大鹏 2020-4-23 15:14
预览时序约束的概念和基本策略	fpga_feixiang 2020-4-22	11339	zxopenhl 2020-4-23 15:13