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预览 USB硬件、概述 fpga_feixiang 2020-6-16 11280 zxopenhl 2020-6-19 11:49
预览 Vivado 软核MicroBlaze添加GPIO后在SDK里Debug admin 2020-6-19 11214 admin 2020-6-19 10:41
预览 大家调试gtp的时候有没有遇到过加上rxbuffer就track总掉,不加rxbuffer就不掉的情况? ccs 2020-6-19 11061 ccs 2020-6-19 10:40
预览 有人用vivado在线调试过DCM么 ccs 2020-6-19 11178 ccs 2020-6-19 10:40
预览 有人基于Dphy搞过mipi没 ccs 2020-6-19 11125 ccs 2020-6-19 10:38
预览 有用过BU65170 的同学吗?咨询点问题,我在控制的时候发送片选和strbd信号后检测不... ccs 2020-6-19 11257 ccs 2020-6-19 10:37
预览 USB数据格式 fpga_feixiang 2020-6-16 11296 大鹏 2020-6-18 14:17
预览 USB的重要关键字 fpga_feixiang 2020-6-16 11123 大鹏 2020-6-18 14:17
预览 USB事务 fpga_feixiang 2020-6-16 11117 zxopenhl 2020-6-18 14:16
预览 USB数据传输方法 fpga_feixiang 2020-6-16 11192 大鹏 2020-6-17 16:56
预览 USB数据包解析 fpga_feixiang 2020-6-16 11237 大鹏 2020-6-17 16:56
预览 usb2.0和3.0 fpga_feixiang 2020-6-11 21407 大鹏 2020-6-16 17:29
预览 USB硬件接口 fpga_feixiang 2020-6-11 21894 大鹏 2020-6-16 17:29
预览 USB总线信号 fpga_feixiang 2020-6-11 21336 zxopenhl 2020-6-16 17:27
预览 USB2.0速度 fpga_feixiang 2020-6-11 21581 大鹏 2020-6-15 17:04
预览 USB数据编解码和位填充 fpga_feixiang 2020-6-11 21279 大鹏 2020-6-15 17:04
预览 USB的重要关键概念 fpga_feixiang 2020-6-12 21199 zxopenhl 2020-6-15 17:03
预览 VHDL和Verilog共同点 fpga_feixiang 2020-6-8 21336 大鹏 2020-6-11 11:29
预览 均值滤波 fpga_feixiang 2020-5-27 21402 大鹏 2020-6-11 11:29
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预览 pn码,m序列产生原理 fpga_feixiang 2020-5-24 41687 大鹏 2020-6-10 14:57
预览 fpga+dsp采集板的接口问题 小泡泡 2010-4-20 23006 大鹏 2020-6-10 14:56
预览 modelsim仿真 attach_img 残酷月光 2020-6-9 21223 大鹏 2020-6-10 14:56
预览 用verilog状态机做一个电梯控制器的课程设计 AAT 2010-6-26 23846 zxopenhl 2020-6-10 14:54
预览 VHDL和Verilog特点 fpga_feixiang 2020-6-8 21377 大鹏 2020-6-9 15:47
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预览 verilog模块的结构 fpga_feixiang 2020-6-8 21285 zxopenhl 2020-6-9 15:43
预览 什么是DDR SDRAM及它的特性 fpga_feixiang 2020-6-5 21283 大鹏 2020-6-6 15:19
预览 深度解析DDR3内存新特性 fpga_feixiang 2020-6-5 31428 大鹏 2020-6-6 15:19
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预览 常用本原多项式 fpga_feixiang 2020-5-24 21225 大鹏 2020-6-3 14:23
预览 哪位大神有AXI的中文协议 求发一下 arteart 2020-6-1 21305 zxopenhl 2020-6-3 14:22
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