集成电路技术分享

 找回密码
 我要注册

QQ登录

只需一步,快速开始

搜索
收藏本版 (8) |订阅

FPGA技术交流 今日: 0|主题: 13231|排名: 3 

作者 回复/查看 最后发表
预览 给年轻fpga工程师的十大忠告 TCL 2010-4-12 43658 Sunlife 2015-4-7 11:42
预览 ISE 12.1现在可以下吗,为什么每次打开都报错 IPO 2010-5-23 12093 Sunlife 2015-4-7 11:42
预览 QuatusII与MAXplusII软件使用的时候是不是功能一样? CPLD 2010-5-23 31985 Sunlife 2015-4-7 11:41
预览 xilinx ISE 11能不能用quartus ii代替啊? vvt 2010-5-6 65432 Sunlife 2015-4-7 11:40
预览 有没有转让v2p板子的啊 CPLD 2010-5-14 11852 Sunlife 2015-4-7 11:39
预览 新版cvavr1.25为什么会出错 老怪甲 2010-5-15 11487 Sunlife 2015-4-7 11:39
预览 怎么把sof固化到cfi admin 2010-5-4 42391 Sunlife 2015-4-7 11:39
预览 请问一下,xilinx公司的System ACE CF解决方案中 ,CF卡可以同时存储程序和数据吗? ccs 2010-5-6 23047 Sunlife 2015-4-7 11:39
预览 请问哪位有Linux64下的Debussy 软件和破解方法 vvt 2010-5-6 12095 Sunlife 2015-4-7 11:38
预览 输入管脚带有上拉电阻, 有时还需要外加上拉电阻, 他们的作用是什么? CPLD 2010-5-3 12127 Sunlife 2015-4-7 11:38
预览 FPGA 设计的四种常用思想与技巧(三) 老怪甲 2010-5-5 11898 Sunlife 2015-4-7 11:37
预览 NiosII IDE 9.0 bug-Cyclone III Nios can't not boot up from EPCS device 老怪甲 2010-5-7 12352 Sunlife 2015-4-7 11:35
预览 FPGA设计---综合工具 老怪甲 2010-5-5 11911 Sunlife 2015-4-7 11:34
预览 FPGA的速度等级(speed grade) 老怪甲 2010-5-5 12858 Sunlife 2015-4-7 11:34
预览 Signal Tap II探测信号时,总是显示“Waiting for clock",为何呢? ccs 2010-5-6 411873 Sunlife 2015-4-7 11:34
预览 ISE11.0 中怎么调用RAM 老怪甲 2010-5-5 22492 Sunlife 2015-4-7 11:21
预览 利用SOPC Builder生成系统时的问题 ccs 2010-5-7 22908 Sunlife 2015-4-7 11:21
预览 一个有趣的现象:聪明的综合工具 老怪甲 2010-5-5 11662 Sunlife 2015-4-7 11:20
预览 FPGA VGA DVI 显示控制系统项目外包 admin 2010-5-6 12743 Sunlife 2015-4-7 11:19
预览 FPGA开发工具介绍 attachment fpga 2010-5-6 22126 Sunlife 2015-4-7 11:19
预览 FPGA设计流程 CPLD 2010-5-6 22055 Sunlife 2015-4-7 11:18
预览 ise中整段怎么屏蔽?? 老怪甲 2010-5-5 22270 Sunlife 2015-4-7 11:18
预览 使用SignalTap II逻辑分析仪调试FPGA 老怪甲 2010-5-5 15722 Sunlife 2015-4-7 11:17
预览 高手看过来:简易鉴相器问题(附代码) 老怪甲 2010-5-5 22203 Sunlife 2015-4-7 11:17
预览 可综合的上电赋初值verilog该怎么写啊 ATA 2010-6-27 11925 Sunlife 2015-4-7 11:16
预览 我不懂cpld 也不懂vhdl 做个数字式气温计  ...23 UFP 2010-6-26 218294 Sunlife 2015-4-7 11:15
预览 verilog语法错误,请大侠指点  ...2 CHANG 2010-6-26 156933 Sunlife 2015-4-7 11:13
预览 CPLD真的可以用例化元件做时钟吗?  ...23 usd 2010-6-26 2811832 Sunlife 2015-4-7 11:12
预览 cpld设计,现在外部时钟是24M,有个输出信号想要延时10ns后输出,请教怎样实现?  ...2 UFO 2010-6-26 156450 Sunlife 2015-4-7 11:11
预览 如何对单独的VHDL子模块文件编译仿真? CHAN 2010-6-26 77398 Sunlife 2015-4-7 11:10
预览 74393M是什么器件? AAT 2010-6-26 52744 Sunlife 2015-4-7 11:08
预览 状态机为什么要next_state这个东西? interi 2010-6-26 83626 Sunlife 2015-4-7 11:07
预览 这个verilog程序不能综合成为状态机? 神仙姐姐 2010-6-26 73176 Sunlife 2015-4-7 11:07
预览 三段式状态机问题 夜带水果刀 2010-6-26 32180 Sunlife 2015-4-7 11:05
预览 状态机到底是什么东西吗?难道就仅仅是指触发器一类的器件吗? VVC 2010-6-26 43202 Sunlife 2015-4-7 11:02
预览 用Q2编译EMP240出错 interig 2010-6-26 31759 Sunlife 2015-4-7 11:01
预览 书写HDL代码的风格 longtime 2010-6-26 32710 Sunlife 2015-4-7 10:58
预览 Verilog里面既然有乘法运算了,为什么FPGA的IP核里还有乘法器这个东西? 老怪甲 2010-6-25 42898 Sunlife 2015-4-7 10:52
预览 菜鸟求助 billcj 2010-6-24 31978 Sunlife 2015-4-7 10:41
预览 请教:在IDE中的奇怪错误 清霜一梦 2010-6-4 32316 Sunlife 2015-4-7 10:39
下一页 »

快速发帖

还可输入 80 个字符
您需要登录后才可以发帖 登录 | 我要注册

本版积分规则

关闭

站长推荐上一条 /1 下一条

QQ|小黑屋|手机版|Archiver|fpga论坛|fpga设计论坛 ( 京ICP备20003123号-1 )

GMT+8, 2025-6-21 12:47 , Processed in 0.059168 second(s), 16 queries .

Powered by Discuz! X3.4

© 2001-2023 Discuz! Team.

返回顶部 返回版块