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预览 设计的电路需要跑到250MHz,altera的fpga哪个能达到? vvt 2011-5-17 32205 Sunlife 2015-4-8 15:22
预览 菜鸟求问,怎么实现FPGA内部储存 hdzlws 2011-5-16 21568 Sunlife 2015-4-8 15:22
预览 关于ddr接口的问题 vvt 2010-10-28 34657 Sunlife 2015-4-8 15:21
预览 基于FPGA的SOC系统中的串口设计 attach_img weibode01 2010-11-12 31958 Sunlife 2015-4-8 15:20
预览 求助,功能仿真是对的,时序仿真是错的 windprayer 2011-1-20 41817 Sunlife 2015-4-8 15:20
预览 TI(德州仪器)导购手册 andersonli 2011-3-1 12407 Sunlife 2015-4-8 15:19
预览 请问谁用verilog做过1-wire通讯 CPLD 2011-3-4 11865 Sunlife 2015-4-8 15:19
预览 错误征集帖 老怪甲 2010-5-25 31996 Sunlife 2015-4-8 15:18
预览 基于FPGA的SOC系统中的串口设计 attach_img weibode01 2010-11-8 11713 Sunlife 2015-4-8 15:18
预览 多路选择器(MUX)Verilog代码 老怪甲 2010-5-28 24503 Sunlife 2015-4-8 15:17
预览 大家谁用过 RS232转RS485的转换芯片啊 guanguan 2010-11-5 22158 Sunlife 2015-4-8 15:17
预览 麻烦帮我看一下这个Verilog程序是哪儿的问题 attach_img 石田宇 2010-10-26 77420 Sunlife 2015-4-8 15:16
预览 刚学习verilog,何如实现8位串并转换  ...2 longtime 2010-6-28 129187 Sunlife 2015-4-8 15:14
预览 请问Verilog两个位数不一样的数是不是右端,就是低端对齐的? vvt 2010-10-23 31872 Sunlife 2015-4-8 15:14
预览 8bit的数,怎样用最简单的电路判断它能被5整除呢? guanguan 2010-10-25 42196 Sunlife 2015-4-8 15:14
预览 关于V5的Rocket/IO的问题讨论 TCL 2010-10-28 83280 Sunlife 2015-4-8 14:51
预览 求助:大家帮忙分析下代码逻辑上的问题,VHDL代码如下 attach_img lwpj 2010-10-27 21498 Sunlife 2015-4-8 14:50
预览 verilog 中测试模块如何对模块检测 ccs 2010-10-26 32524 Sunlife 2015-4-8 14:48
预览 ISE10.1下Virtex5如何开方? TCL 2010-10-28 53308 Sunlife 2015-4-8 14:48
预览 怎样估算板卡整体功耗的? TCL 2010-10-28 41701 Sunlife 2015-4-8 14:48
预览 请问我想产生两个相位差90度的方波信号,仿真测试用,用Verilog HDL怎么写? IPO 2010-10-29 45150 Sunlife 2015-4-8 14:47
预览 请问Verilog两个位数不一样的数是不是右端,就是低端对齐的? vvt 2010-10-23 53789 Sunlife 2015-4-8 14:45
预览 请问 FPGA 空闲的 IO 管脚如何处理? lwjiee 2010-10-19 22997 Sunlife 2015-4-8 14:45
预览 VHDL奇怪问题,和老师研究半天了,两桥箱的电梯控制 小泡泡 2010-4-23 12200 Sunlife 2015-4-8 14:44
预览 .bit怎么才能生成.mcs文件呢 TCL 2010-4-22 12865 Sunlife 2015-4-8 14:43
预览 请问数据总线16位是,地址总线最低位是悬空吗 I2C 2010-4-23 22133 Sunlife 2015-4-8 14:43
预览 怎样利用VHDL语言实现除法功能? 小泡泡 2010-4-23 22679 Sunlife 2015-4-8 14:41
预览 FPGA设计开发中应用仿真技术解决故障的方法 小泡泡 2010-4-23 12259 Sunlife 2015-4-8 14:39
预览 数字系统设计中VHDL语言设计问题探讨 小泡泡 2010-4-23 12050 Sunlife 2015-4-8 14:39
预览 请教当fifo输入输出带宽不相等时应该怎样处理? 老怪甲 2010-4-16 94134 Sunlife 2015-4-8 14:38
预览 有关vhdl问题求救,望各位前辈不吝赐教! 小泡泡 2010-4-23 13374 Sunlife 2015-4-8 14:38
预览 ISE有没有运用指南,貌似Q2里面有Q2的操作指南 TCL 2010-4-22 32764 Sunlife 2015-4-8 14:37
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预览 请问一下,我想用一个32位数据,怎样定义数据类型 TCL 2010-4-19 32191 Sunlife 2015-4-8 14:30
预览 利用FPGA实现基于RU算法编码器的设计 ddr 2010-4-19 12121 Sunlife 2015-4-8 14:30
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