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预览 关于V5的Rocket/IO的问题讨论 TCL 2010-10-28 83101 Sunlife 2015-4-8 14:51
预览 求助:大家帮忙分析下代码逻辑上的问题,VHDL代码如下 attach_img lwpj 2010-10-27 21338 Sunlife 2015-4-8 14:50
预览 verilog 中测试模块如何对模块检测 ccs 2010-10-26 32405 Sunlife 2015-4-8 14:48
预览 ISE10.1下Virtex5如何开方? TCL 2010-10-28 53179 Sunlife 2015-4-8 14:48
预览 怎样估算板卡整体功耗的? TCL 2010-10-28 41581 Sunlife 2015-4-8 14:48
预览 请问我想产生两个相位差90度的方波信号,仿真测试用,用Verilog HDL怎么写? IPO 2010-10-29 45006 Sunlife 2015-4-8 14:47
预览 请问Verilog两个位数不一样的数是不是右端,就是低端对齐的? vvt 2010-10-23 53627 Sunlife 2015-4-8 14:45
预览 请问 FPGA 空闲的 IO 管脚如何处理? lwjiee 2010-10-19 22880 Sunlife 2015-4-8 14:45
预览 VHDL奇怪问题,和老师研究半天了,两桥箱的电梯控制 小泡泡 2010-4-23 12102 Sunlife 2015-4-8 14:44
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预览 ISE有没有运用指南,貌似Q2里面有Q2的操作指南 TCL 2010-4-22 32535 Sunlife 2015-4-8 14:37
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