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楼主: lcytms

跟李凡老师学FPGA之VHDL基础D01(20160720课堂笔记)

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 楼主| lcytms 发表于 2018-10-24 09:49:14 | 显示全部楼层
0919
        并且发明了它的仿真器。
        发展到了1985年,他就觉得Verilog这个产品,应该有一个专用的公司,公司更名为GDA,Gateway Design Automation。
 楼主| lcytms 发表于 2018-10-25 09:01:41 | 显示全部楼层
0920
        这个公司真正是一个商业化的公司,像真正的硅谷公司那样的,前面的公司带有尝试色彩的。
        这个时候,他把他的语言进一步地完善,并且发布了一个称之为Verilog-XL的,快速门级仿真的算法。
        在今天这个算法仍然在被使用,它是用于综合的一种算法。
        虽然他的Verilog也在发展,但是Verilog脱胎于C语言体系。
        我们马上就可以做这两种语言的对比。
        Verilog学到今天,我们会总结一下,Verilog是几大怪。
        有说四大怪,有说八大怪。
 楼主| lcytms 发表于 2018-10-26 09:10:11 | 显示全部楼层
0921
        业界总结了几大怪,我来说一下。
        挺有意思。学到今天,我们可以稍微做一下总结。
        如果没有学到今天,我们理解不了为什么有几大怪。
        我们马上就会来讨论VHDL的具体的语法,因为它是比较严谨的。
        像Verilog的几大怪,寄存器要自己猜。
        我们把它声明成reg了,但是综合出来不一定是reg。
 楼主| lcytms 发表于 2018-10-27 09:35:46 | 显示全部楼层
本帖最后由 lcytms 于 2018-10-27 16:27 编辑

0922
        它有的时候是,有的时候不是。
        虽然行为的输出一定要声明成reg,但是最后是否得到寄存器,就完全不一定。
        就看综合器了。
        它愿意变成寄存器就变成寄存器。
        所以说称之为寄存器要自己猜。
        阻与不阻随便来。
        阻塞和非阻塞,有的时候怎么写都是对的。
        常数当作参数用。
        这是2005年以前的。
        2005以前只有一个parameter。
        常数参数是不分的。
        常数要封装,参数是要传递的。
        2005之前,全部只有一个parameter。
        这是他的商业行为造成的四大怪。
        分号当帽头上戴。
        我们知道任何一种语言的分号都是打在语言的最末尾。
        Verilog,世界上只有一种语言,分号是有的时候打在上面,有的时候打在下面。
        就是Verilog,没有第二种语言,有这么混乱。
 楼主| lcytms 发表于 2018-10-29 09:22:15 | 显示全部楼层
0923
        所以说Verilog诞生之初呢,它的学术色彩并不浓厚,并且有非常强烈的商业的行为,他的编译团队为了追赶市场,有很多商业行为。
        所以说愿意接触它、了解它的工程师并不多。
        莫比成立的这家GDA公司,是一个商业化的公司,是一个民营企业,如果没有人买他的产品,他就要破产了。
        他的公司就要倒闭了。他绝对不能让公司倒闭。
        因此菲尔莫比他就想到了一件事,来保证他的公司有源源不断的流水,能够维持他的公司。
        就是用互联网。
 楼主| lcytms 发表于 2018-10-30 09:20:04 | 显示全部楼层
0924
        他成立了一个共同组织,一个叫OVI的国际组织,Open Verilog International。
        正是通过这个组织,世界上很多工程师了解了Verilog。
        因为他是这么说的,全世界的做Verilog的工程师,你把你的代码传到OVI的平台上,然后大家可以免费地分享。
        因为那个时候规模还不是特别大,知识产权保护的意思不是特别强,投入也不是特别多,没有太多的知识产权保护的需要。
        所以说OVI呢得到了一些人的支持,了解OVI的人越来越多。
 楼主| lcytms 发表于 2018-10-31 09:23:00 | 显示全部楼层
0925
        因为很多人要写代码要写模块,没有怎么办?
        OVI上下载一个,当然来得快了。
        通过这种方式呢,越来越多的人接触到了Verilog。
        就了解到,世界上居然有这样一种语言,它虽然不严谨,虽然看起来很可笑,但是非常方便,非常灵活。
        以至于发展到现在,灵活性战胜了它的科学严谨。
        现在大多数的人转向了Verilog。
        VHDL作为一种经典的完美的具有学术风格的语言呢,直到今天仍然有它非常重要的意义。
        我们马上就会通过它的学习来了解这一点。
        以至于System Verilog发展的时候没有继承VHDL,继承的是Verilog,因为Verilog有很多方便的地方。
 楼主| lcytms 发表于 2018-11-1 09:34:50 | 显示全部楼层
0926
        它有非常值得反转的地方。
        但是它是结合了两个语言的优势。
        反转是一个什么概念呢?
        Verilog在发展之初,它有很多商业化的行为,非学术的商业化的行为,当初看来是非常荒谬可笑的,甚至是一个bug,是缺陷。
        但是正是由于这种缺陷,当初认为是缺陷,2012以后反转了。
        其中有一个例子,就是阻塞与非阻塞,原本就是C语言下面的经典的一个内容,就是C语言体系下面用于blocking、non blocking用于进程处理的需要。
        但是阻塞这个概念在正宗的VHDL体系下面,是绝对没有体现的。
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