跟李凡老师学FPGA之VHDL基础D01（20160720课堂笔记）

1607
        （分享设计）。
        写仿真。

1608
        （分享设计）。
        写仿真。

1609
        （分享设计）。
        写仿真。
        把mem的信号拷过来。
        忘掉了库。
        打开。
        拷贝粘贴。
  

1610
        （分享设计）。
        写仿真。

1611
        （分享设计）。
        写仿真。

1612
        （分享设计）。
        写仿真。

1613
        （分享设计）。
        写仿真。
        Reset注释掉。
        Dqs_n注释掉。
        加上addr。

1614
        （分享设计）。
        写仿真。
        到顶层。
        0:0的线还没有做。

1615
        （分享设计）。
        写仿真。
        片选，cke，两个时钟，还有odt。

1616
        （分享设计）。
        写仿真。
        复制第十行到tb上去。
        然后把对应的删掉。
        片选删掉，cke删掉。
        两个时钟删掉。
        Odt删掉。
        然后写激励。