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预览 ise工程问题 老怪甲 2010-4-24 32486 Sunlife 2015-5-14 13:48
预览 VHDL设计MOORE型有限状态机时速度问题 小泡泡 2010-4-23 22510 Sunlife 2015-5-14 13:47
预览 请问一下在QuartusII中怎样加中文注释 attachment ccs 2010-4-30 54204 Sunlife 2015-5-14 13:47
预览 浅谈MAX+PLUSⅡ的设计技巧问题 小泡泡 2010-4-23 22318 Sunlife 2015-5-14 13:46
预览 UART控制器的设计注意事项? ccs 2010-5-2 73796 Sunlife 2015-5-14 13:45
预览 关于verilog语句中的延时 老怪甲 2010-4-16 32508 Sunlife 2015-5-14 13:45
预览 急问verilong的时序问题(附程序) 小泡泡 2010-4-23 22198 Sunlife 2015-5-14 13:45
预览 基于FPGA的数字频率计的设计硬件设计部分的问题 小泡泡 2010-4-23 22033 Sunlife 2015-5-14 13:44
预览 Xilinx 的XC2VP70要跑到160MHz容易实现吗? CPLD 2010-4-10 22199 Sunlife 2015-5-14 13:44
预览 请问大家,总线与5v通信接口大家习惯怎么搞,芯片or电压钳位? ddr 2010-4-12 22154 Sunlife 2015-5-14 13:43
预览 怎么在线看FPGA里面的一个变量的值?大家用什么方法? TCL 2010-4-12 22384 Sunlife 2015-5-14 13:41
预览 使用xilinx FPGA芯片时,有没有遇到经过锁相环的时钟突然不工作的情况 TCL 2010-4-12 22385 Sunlife 2015-5-14 13:40
预览 请教VHDL语言做波形发生器中编译问题!! 小泡泡 2010-4-23 22390 Sunlife 2015-5-14 11:44
预览 AD 采样值是 0---》 2^12 , 可是,它就一定表示采集的电压值是 从0 开始的吗? vvt 2010-4-29 32509 Sunlife 2015-5-14 11:42
预览 关于信号赋初值、及进程启动的问题!(VHDL) 小泡泡 2010-4-23 23148 Sunlife 2015-5-14 11:42
预览 时钟奇数分频的用途 20080067 2010-4-29 42559 Sunlife 2015-5-14 11:41
预览 关于VHDL与verilogHDL的选择问题!!! 小泡泡 2010-4-23 22208 Sunlife 2015-5-14 11:32
预览 求助用VHDL语言编程 VHDL菜鸟 2010-4-24 53278 Sunlife 2015-5-14 11:32
预览 ep3c5 多少钱? 20080067 2010-4-27 21605 Sunlife 2015-5-14 11:31
预览 我有一个问题 20080067 2010-4-27 21773 Sunlife 2015-5-14 11:31
预览 VHDL 输入输出端口怎样使用自定义类型? 20080067 2010-4-27 21982 Sunlife 2015-5-14 11:31
预览 定制PLL的时候怎么没E0的呢?C0和E0有什么区别呢?一定要用E0的吗?? vvt 2010-4-29 42450 Sunlife 2015-5-14 11:30
预览 双口RAM ip核为什么不能同时读写啊 vvt 2010-4-29 57860 Sunlife 2015-5-14 11:30
预览 把nios2的程序烧到EPCS里和烧到并行的Flash里有什么区别吗? vvt 2010-4-29 55017 Sunlife 2015-5-14 11:29
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预览 Verilog HDL语法基础(1)-Verilog的词法约定 TCL 2010-4-29 65201 Sunlife 2015-5-14 11:27
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