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预览 状态机可以嵌套吗？就是一个state和一个sub_state?还是得把它们写成并列的状态呢？ VVIC 2010-6-26 22388 tim 2010-6-26 02:07
预览 用verilog编写testbench,ModelSim的大牛可否过来指点一下？ interig 2010-6-26 03441 interig 2010-6-26 02:06
预览 如何不让Quartus2生成这些后缀的文件？ CHA 2010-6-26 02070 CHA 2010-6-26 02:06
预览 有关moore，mealy两种状态机的教程吗？ AAT 2010-6-26 22590 CHA 2010-6-26 02:04
预览 CPLD可以接几个晶振 CHAN 2010-6-26 02228 CHAN 2010-6-26 02:03
预览 谁用过synplicity 的 Certify CHAN 2010-6-26 02116 CHAN 2010-6-26 02:03
预览 [求教]关于VHDL变量在状态机中赋值的问题 VVC 2010-6-26 02158 VVC 2010-6-26 02:03
预览 谁使用过STRATIX1S10这块板子？ usb 2010-6-26 01841 usb 2010-6-26 02:02
预览 [求助]assign package pins时出问题 VVIC 2010-6-26 02069 VVIC 2010-6-26 02:01
预览 [求助]ISE在VHDL中怎样使用一个编译好的SCH资源？ ICE 2010-6-26 02101 ICE 2010-6-26 01:58
预览 请教：不同的工艺库仿真时对不定态的处理问题 别生气咯 2010-6-26 12155 豆芽 2010-6-26 01:58
预览 CPLD接RC滤波器问题 CCIE 2010-6-26 02087 CCIE 2010-6-26 01:56
预览 VHDL生成图元以后，在原理图文件中使用 usd 2010-6-26 12137 interige 2010-6-26 01:54
预览 CPLD 8051内核的BDF HANG 2010-6-26 02153 HANG 2010-6-26 01:53
预览 我的状态机是怎么回事?? AAT 2010-6-26 12440 HANG 2010-6-26 01:52
预览 状态机的问题，请教高手关于状态机的研究思路 CHAN 2010-6-26 02160 CHAN 2010-6-26 01:52
预览 VHDL编好程序后加载到CPLD中数据紊乱问题??? interig 2010-6-26 12509 UFP 2010-6-26 01:51
预览 高手发一下基于VERILOG的状态机, UFP 2010-6-26 12575 CHANG 2010-6-26 01:51
预览 CPLD语言：想用一个模块实现延迟功能，并且能够在仿真中看出 inter 2010-6-26 12485 UFP 2010-6-26 01:49
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预览 请教时钟选择器的程序 encounter 2010-6-26 02120 encounter 2010-6-26 01:46
预览 在VHDL 里想用FORCE ,应该用什么命令呢? ICE 2010-6-26 02263 ICE 2010-6-26 01:45
预览 VHDL设计一个T接线器 ngtim 2010-6-26 12394 UFO 2010-6-26 01:44
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预览 请教：在开发板里面需要时钟的处理？ VVC 2010-6-26 12068 VVC 2010-6-26 01:42
预览 cpld的数据存储如何实现的CPLD如和把一个数存在cpld里面呢 HDL 2010-6-26 12047 longtim 2010-6-26 01:42
预览 请问有DLL的最小的CPLD有什么型号可以选择的？ interi 2010-6-26 12167 VVC 2010-6-26 01:41
预览 cpld中如何输出高阻态：引脚定义为inout，但是综合时出现错误 usd 2010-6-26 14691 ICE 2010-6-26 01:39
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预览 问个问题：“锁存器建模时，用非阻塞赋值”为什么不可以用阻塞呢？ ngtim 2010-6-26 02185 ngtim 2010-6-26 01:32
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