FPGA技术交流今日: 0|主题: 13367|排名: 7

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预览 wire对应于连续赋值，reg对应于过程赋值 ...2 3	ANG 2010-6-26	2913364	Sunlife 2015-6-25 11:03
预览学Verilog HDL 用哪个厂家软件好啊？ ...2 3	CHANG 2010-6-26	2511078	Sunlife 2015-6-25 10:48
预览 VERILOG中那些延时语句有什么作用 ...2 3	ups 2010-6-26	2611374	Sunlife 2015-6-25 10:47
预览非常详细的Verilog代码编写规范（转） ...2 3	usb 2010-6-26	2710951	Sunlife 2015-6-25 10:47
预览学fpga什么情况下会生成latch ...2 3	usd 2010-6-26	2918817	Sunlife 2015-6-25 10:46
预览 Quartus编译时出现这个错误，该怎样修改 ...2 3	VVIC 2010-6-26	2612662	Sunlife 2015-6-25 10:45
预览 CPLD的LED的设置IO口输出不行？ ...2 3	inter 2010-6-26	2311656	Sunlife 2015-6-25 10:45
预览问一个关于赋值语句的问题设置参数为负数 ...2 3	ATA 2010-6-26	2611271	Sunlife 2015-6-25 10:43
预览哪位有Alter FPGA/CPLD 设计（基础篇）得例子啊 ...2 3	CHA 2010-6-26	2310096	Sunlife 2015-6-25 10:42
预览信号命名规范（转发） ...2 3	VVC 2010-6-26	219927	Sunlife 2015-6-25 10:41
预览问个verilog技巧 ...2 3	AAT 2010-6-26	228057	Sunlife 2015-6-25 10:41
预览什么叫状态机？ ...2 3	CHAN 2010-6-26	209414	Sunlife 2015-6-25 10:40
预览 FPGA如何实现PCI	yangfan5566 2010-6-26	11796	Sunlife 2015-6-25 10:40
预览怎样区分wire和reg？ ...2 3	CHANG 2010-6-26	2510161	Sunlife 2015-6-25 10:39
预览米利和摩尔状态机比较各有什么优点？ ...2	interig 2010-6-26	1812051	Sunlife 2015-6-25 10:38
预览数字系统设计与VerilogHDL	20080067 2010-5-3	42884	Sunlife 2015-6-25 10:38
预览要用到cpld与c51单片机采用总线方式连接，单片机用来读取cpld采集的数据 ...2	CHANG 2010-6-26	187067	Sunlife 2015-6-25 10:38
预览有这样的负值语句吗? ...2	HDL 2010-6-26	195596	Sunlife 2015-6-25 10:37
预览 CPLD如何使用晶振？ ...2 3	CCIE 2010-6-26	2110894	Sunlife 2015-6-25 10:37
预览模块中有几个ALWAYS，那么综合时是按先后综合吗？ ...2	UFO 2010-6-26	186915	Sunlife 2015-6-25 10:37
预览请教Verilog语言中的一个问题 ...2	CHA 2010-6-26	197367	Sunlife 2015-6-25 10:35
预览这种加延迟的codestyle是啥意思？(问题已解决) ...2	UFP 2010-6-26	196773	Sunlife 2015-6-25 10:35
预览 CPLD的IO口怎么互相赋值？ ...2 3	CTT 2010-6-26	219327	Sunlife 2015-6-25 10:35
预览请问状态机的好处？ ...2	tim 2010-6-26	198926	Sunlife 2015-6-25 10:34
预览 [求助]状态机嵌套如何实现？ ...2	ICE 2010-6-26	1723543	Sunlife 2015-6-25 10:33
预览 fpga高手帮个忙#5 a=b 和a =#5 b有什么区别？ ...2	UFP 2010-6-26	168278	Sunlife 2015-6-25 10:32
预览 dff和latch的区别？指得是QUARTUS2下，ALTERA提供得这两个模块有什么区别？？ ...2	longt 2010-6-26	1814044	Sunlife 2015-6-25 10:32
预览分析和综合不下去了程序里用了很多for，不知道是不是太多了，电脑吃不消？ ...2	ANG 2010-6-26	166360	Sunlife 2015-6-25 10:31
预览如何在大的状态机里面加入小的状态机？ ...2	HDL 2010-6-26	168641	Sunlife 2015-6-25 10:30
预览请教如何实现精确延迟 ...2	ups 2010-6-26	177546	Sunlife 2015-6-25 10:30
预览 VHDL实现移相问题。。请问怎么用40MHZ的时钟实现10ns左右的移相 ...2	interig 2010-6-26	166848	Sunlife 2015-6-25 10:29
预览请教一个状态机进行序列检测的问题 ...2	VVC 2010-6-26	157443	Sunlife 2015-6-25 10:28
预览基于CPLD/FPGA自动绕线机的设计 ...2	encounter 2010-6-26	179313	Sunlife 2015-6-25 10:21
预览 vhdl变成verilog的问题	ngtim 2010-6-26	63657	Sunlife 2015-6-25 10:16
预览异步 ...2	longtime 2010-6-26	166957	Sunlife 2015-6-25 10:16
预览怎样把maxplusii中原理图变为vhdl ...2	CCIE 2010-6-26	157313	Sunlife 2015-6-25 10:16
预览请教fpga高手：状态机状态不稳定的原因 ...2	CTT 2010-6-26	158501	Sunlife 2015-6-25 10:14
预览关于如何把组合逻辑添加到三段式状态机中的问题 ...2	interig 2010-6-26	168750	Sunlife 2015-6-25 10:02
预览下列两种表述有何差别？ ...2	VVC 2010-6-26	125357	Sunlife 2015-6-25 10:01
预览 one-hot state encode 是什么意思? ...2	ANG 2010-6-26	167272	Sunlife 2015-6-25 10:01